Cross Reference: /src/sys/arch/arm/nvidia/tegra_drm

Lines Matching refs:HDMI_WRITE
933 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_PLL0_REG, tmds->sor_pll0);
934 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_PLL1_REG, tmds->sor_pll1);
935 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_LANE_DRIVE_CURRENT_REG,
937 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_PE_CURRENT_REG,
939 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_IO_PEAK_CURRENT_REG,
941 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_PAD_CTLS0_REG,
945 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_REFCLK_REG,
963 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_SEQ_INST0_REG, inst);
964 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_SEQ_INST8_REG, inst);
970 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_INPUT_CONTROL_REG, input_ctrl);
983 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_PWR_REG,
987 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_PWR_REG,
1010 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_STATE2_REG, state2);
1012 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_STATE1_REG,
1017 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_STATE0_REG, 0);
1019 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_STATE0_REG,
1025 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_STATE0_REG, 0);
1038 	HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_HDMI_CTRL_REG, ctrl);
1049 		HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_SOR_AUDIO_CNTRL0_REG,
1053 		HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_AUDIO_N_REG,
1058 		HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_HDMI_SPARE_REG,
1067 		HDMI_WRITE(tegra_encoder,
1070 		HDMI_WRITE(tegra_encoder,
1077 		HDMI_WRITE(tegra_encoder,
1083 		HDMI_WRITE(tegra_encoder,
1086 		HDMI_WRITE(tegra_encoder,
1090 		HDMI_WRITE(tegra_encoder,
1098 		HDMI_WRITE(tegra_encoder,
1101 		HDMI_WRITE(tegra_encoder,
1105 		HDMI_WRITE(tegra_encoder,
1108 		HDMI_WRITE(tegra_encoder,
1112 		HDMI_WRITE(tegra_encoder,
1116 		HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_HDMI_GENERIC_CTRL_REG,
1118 		HDMI_WRITE(tegra_encoder,
1121 		HDMI_WRITE(tegra_encoder,
1124 		HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_HDMI_ACR_CTRL_REG, 0);
1126 		HDMI_WRITE(tegra_encoder,
1128 		HDMI_WRITE(tegra_encoder,
1130 		HDMI_WRITE(tegra_encoder,
1132 		HDMI_WRITE(tegra_encoder, HDMI_NV_PDISP_HDMI_ACR_CTRL_REG, 0);
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