1 /* $NetBSD: qcom,gcc-sm8350.h,v 1.1.1.1 2021/11/07 16:49:57 jmcneill Exp $ */ 2 3 /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */ 4 /* 5 * Copyright (c) 2019-2020, The Linux Foundation. All rights reserved. 6 * Copyright (c) 2020-2021, Linaro Limited 7 */ 8 9 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_SM8350_H 10 #define _DT_BINDINGS_CLK_QCOM_GCC_SM8350_H 11 12 /* GCC HW clocks */ 13 #define CORE_BI_PLL_TEST_SE 0 14 #define PCIE_0_PIPE_CLK 1 15 #define PCIE_1_PIPE_CLK 2 16 #define UFS_CARD_RX_SYMBOL_0_CLK 3 17 #define UFS_CARD_RX_SYMBOL_1_CLK 4 18 #define UFS_CARD_TX_SYMBOL_0_CLK 5 19 #define UFS_PHY_RX_SYMBOL_0_CLK 6 20 #define UFS_PHY_RX_SYMBOL_1_CLK 7 21 #define UFS_PHY_TX_SYMBOL_0_CLK 8 22 #define USB3_PHY_WRAPPER_GCC_USB30_PIPE_CLK 9 23 #define USB3_UNI_PHY_SEC_GCC_USB30_PIPE_CLK 10 24 25 /* GCC clocks */ 26 #define GCC_AGGRE_NOC_PCIE_0_AXI_CLK 11 27 #define GCC_AGGRE_NOC_PCIE_1_AXI_CLK 12 28 #define GCC_AGGRE_NOC_PCIE_TBU_CLK 13 29 #define GCC_AGGRE_UFS_CARD_AXI_CLK 14 30 #define GCC_AGGRE_UFS_CARD_AXI_HW_CTL_CLK 15 31 #define GCC_AGGRE_UFS_PHY_AXI_CLK 16 32 #define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK 17 33 #define GCC_AGGRE_USB3_PRIM_AXI_CLK 18 34 #define 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#define HLOS1_VOTE_MMNOC_MMU_TBU_HF1_GDSC 7 265 #define HLOS1_VOTE_MMNOC_MMU_TBU_SF0_GDSC 8 266 #define HLOS1_VOTE_MMNOC_MMU_TBU_SF1_GDSC 9 267 268 #endif 269
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