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  /src/sys/external/bsd/drm2/dist/drm/amd/amdgpu/
amdgpu_umc_v6_1.c 124 WREG32_PCIE((ecc_err_cnt_sel_addr + umc_reg_offset) * 4, ecc_err_cnt_sel);
130 WREG32_PCIE((ecc_err_cnt_addr + umc_reg_offset) * 4, UMC_V6_1_CE_CNT_INIT);
135 WREG32_PCIE((ecc_err_cnt_sel_addr + umc_reg_offset) * 4, ecc_err_cnt_sel);
141 WREG32_PCIE((ecc_err_cnt_addr + umc_reg_offset) * 4, UMC_V6_1_CE_CNT_INIT);
339 WREG32_PCIE((ecc_err_cnt_sel_addr + umc_reg_offset) * 4, ecc_err_cnt_sel);
341 WREG32_PCIE((ecc_err_cnt_addr + umc_reg_offset) * 4, UMC_V6_1_CE_CNT_INIT);
346 WREG32_PCIE((ecc_err_cnt_sel_addr + umc_reg_offset) * 4, ecc_err_cnt_sel);
347 WREG32_PCIE((ecc_err_cnt_addr + umc_reg_offset) * 4, UMC_V6_1_CE_CNT_INIT);
amdgpu_nbio_v6_1.c 175 WREG32_PCIE(smnCPM_CONTROL, data);
195 WREG32_PCIE(smnPCIE_CNTL2, data);
275 WREG32_PCIE(smnPCIE_CONFIG_CNTL, data);
281 WREG32_PCIE(smnPCIE_CI_CNTL, data);
amdgpu_nbio_v2_3.c 224 WREG32_PCIE(smnCPM_CONTROL, data);
244 WREG32_PCIE(smnPCIE_CNTL2, data);
324 WREG32_PCIE(smnPCIE_CONFIG_CNTL, data);
amdgpu_nbio_v7_4.c 224 WREG32_PCIE(smnPCIE_CNTL2, data);
510 WREG32_PCIE(smnRAS_GLOBAL_STATUS_LO, global_sts);
514 WREG32_PCIE(smnPARITY_ERROR_STATUS_UNCORR_GRP2,
520 WREG32_PCIE(smnBIFL_RAS_CENTRAL_STATUS, central_sts);
524 WREG32_PCIE(smnIOHC_INTERRUPT_EOI, int_eoi);
amdgpu_cik.c 1537 WREG32_PCIE(ixPCIE_LC_LINK_WIDTH_CNTL, tmp);
1563 WREG32_PCIE(ixPCIE_LC_CNTL4, tmp);
1567 WREG32_PCIE(ixPCIE_LC_CNTL4, tmp);
1614 WREG32_PCIE(ixPCIE_LC_CNTL4, tmp);
1623 WREG32_PCIE(ixPCIE_LC_SPEED_CNTL, speed_cntl);
1638 WREG32_PCIE(ixPCIE_LC_SPEED_CNTL, speed_cntl);
1669 WREG32_PCIE(ixPCIE_LC_N_FTS_CNTL, data);
1674 WREG32_PCIE(ixPCIE_LC_CNTL3, data);
1679 WREG32_PCIE(ixPCIE_P_CNTL, data);
1692 WREG32_PCIE(ixPCIE_LC_CNTL, data)
    [all...]
amdgpu_nbio_v7_0.c 176 WREG32_PCIE(smnNBIF_MGCG_CTRL_LCLK, data);
218 WREG32_PCIE(smnPCIE_CNTL2, data);
amdgpu_soc15.c 861 WREG32_PCIE(smnPCIE_PERF_CNTL_TXCLK, perfctr);
867 WREG32_PCIE(smnPCIE_PERF_COUNT_CNTL, 0x00000005);
876 WREG32_PCIE(smnPCIE_PERF_COUNT_CNTL, 0x00000002);
910 WREG32_PCIE(smnPCIE_PERF_CNTL_TXCLK3, perfctr);
916 WREG32_PCIE(smnPCIE_PERF_COUNT_CNTL, 0x00000005);
925 WREG32_PCIE(smnPCIE_PERF_COUNT_CNTL, 0x00000002);
amdgpu_vi.c 1035 WREG32_PCIE(ixPCIE_PERF_CNTL_TXCLK, perfctr);
1041 WREG32_PCIE(ixPCIE_PERF_COUNT_CNTL, 0x00000005);
1050 WREG32_PCIE(ixPCIE_PERF_COUNT_CNTL, 0x00000002);
1440 WREG32_PCIE(ixPCIE_CNTL2, data);
amdgpu_si.c 1381 WREG32_PCIE(ixPCIE_PERF_CNTL_TXCLK, perfctr);
1387 WREG32_PCIE(ixPCIE_PERF_COUNT_CNTL, 0x00000005);
1396 WREG32_PCIE(ixPCIE_PERF_COUNT_CNTL, 0x00000002);
1899 WREG32_PCIE(PCIE_P_CNTL, data);
2062 WREG32_PCIE(PCIE_CNTL2, data);
amdgpu_cgs.c 101 return WREG32_PCIE(index, value);
amdgpu_debugfs.c 319 WREG32_PCIE(*pos >> 2, value);
amdgpu.h 1063 #define WREG32_PCIE(reg, v) adev->pcie_wreg(adev, (reg), (v))
amdgpu_gmc_v7_0.c 893 WREG32_PCIE(ixPCIE_CNTL2, data);
  /src/sys/external/bsd/drm2/dist/drm/radeon/
radeon_r300.c 101 WREG32_PCIE(RADEON_PCIE_TX_GART_CNTL, tmp | RADEON_PCIE_TX_GART_INVALIDATE_TLB);
103 WREG32_PCIE(RADEON_PCIE_TX_GART_CNTL, tmp);
197 WREG32_PCIE(RADEON_PCIE_TX_GART_CNTL, tmp);
198 WREG32_PCIE(RADEON_PCIE_TX_GART_START_LO, rdev->mc.gtt_start);
200 WREG32_PCIE(RADEON_PCIE_TX_GART_END_LO, tmp);
201 WREG32_PCIE(RADEON_PCIE_TX_GART_START_HI, 0);
202 WREG32_PCIE(RADEON_PCIE_TX_GART_END_HI, 0);
204 WREG32_PCIE(RADEON_PCIE_TX_GART_BASE, table_addr);
206 WREG32_PCIE(RADEON_PCIE_TX_DISCARD_RD_ADDR_LO, rdev->mc.vram_start);
207 WREG32_PCIE(RADEON_PCIE_TX_DISCARD_RD_ADDR_HI, 0)
    [all...]
radeon_si.c 5589 WREG32_PCIE(PCIE_CNTL2, data);
7313 WREG32_PCIE(PCIE_P_CNTL, data);
7476 WREG32_PCIE(PCIE_CNTL2, data);
radeon_rv6xx_dpm.c 140 WREG32_PCIE(PCIE_P_CNTL, tmp);
radeon_rv770_dpm.c 131 WREG32_PCIE(PCIE_P_CNTL, tmp);
radeon.h 2604 #define WREG32_PCIE(reg, v) rv370_pcie_wreg(rdev, (reg), (v))
  /src/sys/external/bsd/drm2/dist/drm/amd/powerplay/
amdgpu_smu_v11_0.c 208 WREG32_PCIE(addr_start, src[i]);
212 WREG32_PCIE(MP1_Public | (smnMP1_PUB_CTRL & 0xffffffff),
214 WREG32_PCIE(MP1_Public | (smnMP1_PUB_CTRL & 0xffffffff),

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