if_rgereg.h revision 1.4.2.1
1 1.4.2.1 thorpej /* $NetBSD: if_rgereg.h,v 1.4.2.1 2021/04/03 22:28:46 thorpej Exp $ */ 2 1.4.2.1 thorpej /* $OpenBSD: if_rgereg.h,v 1.6 2020/12/24 01:00:00 kevlo Exp $ */ 3 1.1 sevan 4 1.1 sevan /* 5 1.4.2.1 thorpej * Copyright (c) 2019, 2020 Kevin Lo <kevlo (at) openbsd.org> 6 1.1 sevan * 7 1.1 sevan * Permission to use, copy, modify, and distribute this software for any 8 1.1 sevan * purpose with or without fee is hereby granted, provided that the above 9 1.1 sevan * copyright notice and this permission notice appear in all copies. 10 1.1 sevan * 11 1.1 sevan * THE SOFTWARE IS PROVIDED "AS IS" AND THE AUTHOR DISCLAIMS ALL WARRANTIES 12 1.1 sevan * WITH REGARD TO THIS SOFTWARE INCLUDING ALL IMPLIED WARRANTIES OF 13 1.1 sevan * MERCHANTABILITY AND FITNESS. IN NO EVENT SHALL THE AUTHOR BE LIABLE FOR 14 1.1 sevan * ANY SPECIAL, DIRECT, INDIRECT, OR CONSEQUENTIAL DAMAGES OR ANY DAMAGES 15 1.1 sevan * WHATSOEVER RESULTING FROM LOSS OF USE, DATA OR PROFITS, WHETHER IN AN 16 1.1 sevan * ACTION OF CONTRACT, NEGLIGENCE OR OTHER TORTIOUS ACTION, ARISING OUT OF 17 1.1 sevan * OR IN CONNECTION WITH THE USE OR PERFORMANCE OF THIS SOFTWARE. 18 1.1 sevan */ 19 1.1 sevan 20 1.1 sevan #define RGE_PCI_BAR0 PCI_MAPREG_START 21 1.1 sevan #define RGE_PCI_BAR1 (PCI_MAPREG_START + 4) 22 1.1 sevan #define RGE_PCI_BAR2 (PCI_MAPREG_START + 8) 23 1.1 sevan 24 1.1 sevan #define RGE_MAC0 0x0000 25 1.1 sevan #define RGE_MAC4 0x0004 26 1.1 sevan #define RGE_MAR0 0x0008 27 1.1 sevan #define RGE_MAR4 0x000c 28 1.1 sevan #define RGE_TXDESC_ADDR_LO 0x0020 29 1.1 sevan #define RGE_TXDESC_ADDR_HI 0x0024 30 1.1 sevan #define RGE_CMD 0x0037 31 1.1 sevan #define RGE_IMR 0x0038 32 1.1 sevan #define RGE_ISR 0x003c 33 1.1 sevan #define RGE_TXCFG 0x0040 34 1.1 sevan #define RGE_RXCFG 0x0044 35 1.1 sevan #define RGE_TIMERCNT 0x0048 36 1.1 sevan #define RGE_EECMD 0x0050 37 1.1 sevan #define RGE_CFG0 0x0051 38 1.1 sevan #define RGE_CFG1 0x0052 39 1.1 sevan #define RGE_CFG2 0x0053 40 1.1 sevan #define RGE_CFG3 0x0054 41 1.1 sevan #define RGE_CFG4 0x0055 42 1.1 sevan #define RGE_CFG5 0x0056 43 1.1 sevan #define RGE_TDFNR 0x0057 44 1.4.2.1 thorpej #define RGE_TIMERINT0 0x0058 45 1.4.2.1 thorpej #define RGE_TIMERINT1 0x005c 46 1.1 sevan #define RGE_CSIDR 0x0064 47 1.1 sevan #define RGE_CSIAR 0x0068 48 1.1 sevan #define RGE_PHYSTAT 0x006c 49 1.1 sevan #define RGE_PMCH 0x006f 50 1.1 sevan #define RGE_EPHYAR 0x0080 51 1.4.2.1 thorpej #define RGE_TIMERINT2 0x008c 52 1.1 sevan #define RGE_TXSTART 0x0090 53 1.1 sevan #define RGE_MACOCP 0x00b0 54 1.1 sevan #define RGE_PHYOCP 0x00b8 55 1.4.2.1 thorpej #define RGE_DLLPR 0x00d0 56 1.1 sevan #define RGE_TWICMD 0x00d2 57 1.1 sevan #define RGE_MCUCMD 0x00d3 58 1.1 sevan #define RGE_RXMAXSIZE 0x00da 59 1.1 sevan #define RGE_CPLUSCMD 0x00e0 60 1.4.2.1 thorpej #define RGE_IM 0x00e2 61 1.1 sevan #define RGE_RXDESC_ADDR_LO 0x00e4 62 1.1 sevan #define RGE_RXDESC_ADDR_HI 0x00e8 63 1.1 sevan #define RGE_PPSW 0x00f2 64 1.4.2.1 thorpej #define RGE_TIMERINT3 0x00f4 65 1.4.2.1 thorpej #define RGE_INTMITI(i) (0x0a00 + (i) * 4) 66 1.1 sevan #define RGE_PHYBASE 0x0a40 67 1.1 sevan #define RGE_ADDR0 0x19e0 68 1.1 sevan #define RGE_ADDR1 0x19e4 69 1.4.2.1 thorpej #define RGE_EEE_TXIDLE_TIMER 0x6048 70 1.1 sevan 71 1.1 sevan /* Flags for register RGE_CMD */ 72 1.1 sevan #define RGE_CMD_RXBUF_EMPTY 0x01 73 1.1 sevan #define RGE_CMD_TXENB 0x04 74 1.1 sevan #define RGE_CMD_RXENB 0x08 75 1.1 sevan #define RGE_CMD_RESET 0x10 76 1.1 sevan 77 1.1 sevan /* Flags for register RGE_ISR */ 78 1.1 sevan #define RGE_ISR_RX_OK 0x00000001 79 1.1 sevan #define RGE_ISR_RX_ERR 0x00000002 80 1.1 sevan #define RGE_ISR_TX_OK 0x00000004 81 1.1 sevan #define RGE_ISR_TX_ERR 0x00000008 82 1.1 sevan #define RGE_ISR_RX_DESC_UNAVAIL 0x00000010 83 1.1 sevan #define RGE_ISR_LINKCHG 0x00000020 84 1.1 sevan #define RGE_ISR_RX_FIFO_OFLOW 0x00000040 85 1.1 sevan #define RGE_ISR_TX_DESC_UNAVAIL 0x00000080 86 1.1 sevan #define RGE_ISR_SWI 0x00000100 87 1.1 sevan #define RGE_ISR_PCS_TIMEOUT 0x00004000 88 1.1 sevan #define RGE_ISR_SYSTEM_ERR 0x00008000 89 1.1 sevan 90 1.1 sevan #define RGE_INTRS \ 91 1.1 sevan (RGE_ISR_RX_OK | RGE_ISR_RX_ERR | RGE_ISR_TX_OK | \ 92 1.4.2.1 thorpej RGE_ISR_TX_ERR | RGE_ISR_RX_DESC_UNAVAIL | RGE_ISR_LINKCHG | \ 93 1.4.2.1 thorpej RGE_ISR_TX_DESC_UNAVAIL | RGE_ISR_PCS_TIMEOUT | RGE_ISR_SYSTEM_ERR) 94 1.1 sevan 95 1.1 sevan #define RGE_INTRS_TIMER \ 96 1.1 sevan (RGE_ISR_RX_ERR | RGE_ISR_TX_ERR | RGE_ISR_PCS_TIMEOUT | \ 97 1.1 sevan RGE_ISR_SYSTEM_ERR) 98 1.1 sevan 99 1.1 sevan /* Flags for register RGE_TXCFG */ 100 1.1 sevan #define RGE_TXCFG_HWREV 0x7cf00000 101 1.1 sevan 102 1.1 sevan /* Flags for register RGE_RXCFG */ 103 1.1 sevan #define RGE_RXCFG_ALLPHYS 0x00000001 104 1.1 sevan #define RGE_RXCFG_INDIV 0x00000002 105 1.1 sevan #define RGE_RXCFG_MULTI 0x00000004 106 1.1 sevan #define RGE_RXCFG_BROAD 0x00000008 107 1.1 sevan #define RGE_RXCFG_RUNT 0x00000010 108 1.1 sevan #define RGE_RXCFG_ERRPKT 0x00000020 109 1.1 sevan #define RGE_RXCFG_VLANSTRIP 0x00c00000 110 1.1 sevan 111 1.1 sevan /* Flags for register RGE_EECMD */ 112 1.1 sevan #define RGE_EECMD_WRITECFG 0xc0 113 1.1 sevan 114 1.1 sevan /* Flags for register RGE_CFG1 */ 115 1.4.2.1 thorpej #define RGE_CFG1_PM_EN 0x01 116 1.1 sevan #define RGE_CFG1_SPEED_DOWN 0x10 117 1.1 sevan 118 1.1 sevan /* Flags for register RGE_CFG2 */ 119 1.4.2.1 thorpej #define RGE_CFG2_PMSTS_EN 0x20 120 1.1 sevan #define RGE_CFG2_CLKREQ_EN 0x80 121 1.1 sevan 122 1.1 sevan /* Flags for register RGE_CFG3 */ 123 1.1 sevan #define RGE_CFG3_RDY_TO_L23 0x02 124 1.4.2.1 thorpej #define RGE_CFG3_WOL_LINK 0x10 125 1.4.2.1 thorpej #define RGE_CFG3_WOL_MAGIC 0x20 126 1.1 sevan 127 1.1 sevan /* Flags for register RGE_CFG5 */ 128 1.1 sevan #define RGE_CFG5_PME_STS 0x01 129 1.4.2.1 thorpej #define RGE_CFG5_WOL_LANWAKE 0x02 130 1.4.2.1 thorpej #define RGE_CFG5_WOL_UCAST 0x10 131 1.4.2.1 thorpej #define RGE_CFG5_WOL_MCAST 0x20 132 1.4.2.1 thorpej #define RGE_CFG5_WOL_BCAST 0x40 133 1.1 sevan 134 1.1 sevan /* Flags for register RGE_CSIAR */ 135 1.1 sevan #define RGE_CSIAR_BYTE_EN 0x0000000f 136 1.1 sevan #define RGE_CSIAR_BYTE_EN_SHIFT 12 137 1.1 sevan #define RGE_CSIAR_ADDR_MASK 0x00000fff 138 1.1 sevan #define RGE_CSIAR_BUSY 0x80000000 139 1.1 sevan 140 1.1 sevan /* Flags for register RGE_PHYSTAT */ 141 1.1 sevan #define RGE_PHYSTAT_FDX 0x0001 142 1.1 sevan #define RGE_PHYSTAT_LINK 0x0002 143 1.1 sevan #define RGE_PHYSTAT_10MBPS 0x0004 144 1.1 sevan #define RGE_PHYSTAT_100MBPS 0x0008 145 1.1 sevan #define RGE_PHYSTAT_1000MBPS 0x0010 146 1.1 sevan #define RGE_PHYSTAT_RXFLOW 0x0020 147 1.1 sevan #define RGE_PHYSTAT_TXFLOW 0x0040 148 1.1 sevan #define RGE_PHYSTAT_2500MBPS 0x0400 149 1.1 sevan 150 1.1 sevan /* Flags for register RGE_EPHYAR */ 151 1.1 sevan #define RGE_EPHYAR_DATA_MASK 0x0000ffff 152 1.1 sevan #define RGE_EPHYAR_BUSY 0x80000000 153 1.1 sevan #define RGE_EPHYAR_ADDR_MASK 0x0000007f 154 1.1 sevan #define RGE_EPHYAR_ADDR_SHIFT 16 155 1.1 sevan 156 1.1 sevan /* Flags for register RGE_TXSTART */ 157 1.1 sevan #define RGE_TXSTART_START 0x0001 158 1.1 sevan 159 1.1 sevan /* Flags for register RGE_MACOCP */ 160 1.1 sevan #define RGE_MACOCP_DATA_MASK 0x0000ffff 161 1.1 sevan #define RGE_MACOCP_BUSY 0x80000000 162 1.1 sevan #define RGE_MACOCP_ADDR_SHIFT 16 163 1.1 sevan 164 1.1 sevan /* Flags for register RGE_PHYOCP */ 165 1.1 sevan #define RGE_PHYOCP_DATA_MASK 0x0000ffff 166 1.1 sevan #define RGE_PHYOCP_BUSY 0x80000000 167 1.1 sevan #define RGE_PHYOCP_ADDR_SHIFT 16 168 1.1 sevan 169 1.4.2.1 thorpej /* Flags for register RGE_DLLPR. */ 170 1.4.2.1 thorpej #define RGE_DLLPR_PFM_EN 0x40 171 1.4.2.1 thorpej #define RGE_DLLPR_TX_10M_PS_EN 0x80 172 1.4.2.1 thorpej 173 1.1 sevan /* Flags for register RGE_MCUCMD */ 174 1.1 sevan #define RGE_MCUCMD_RXFIFO_EMPTY 0x10 175 1.1 sevan #define RGE_MCUCMD_TXFIFO_EMPTY 0x20 176 1.1 sevan #define RGE_MCUCMD_IS_OOB 0x80 177 1.1 sevan 178 1.1 sevan /* Flags for register RGE_CPLUSCMD */ 179 1.1 sevan #define RGE_CPLUSCMD_RXCSUM 0x0020 180 1.1 sevan 181 1.1 sevan #define RGE_TX_NSEGS 32 182 1.1 sevan #define RGE_TX_LIST_CNT 1024 183 1.1 sevan #define RGE_RX_LIST_CNT 1024 184 1.1 sevan #define RGE_ALIGN 256 185 1.1 sevan #define RGE_TX_LIST_SZ (sizeof(struct rge_tx_desc) * RGE_TX_LIST_CNT) 186 1.1 sevan #define RGE_RX_LIST_SZ (sizeof(struct rge_rx_desc) * RGE_RX_LIST_CNT) 187 1.1 sevan #define RGE_NEXT_TX_DESC(x) (((x) + 1) % RGE_TX_LIST_CNT) 188 1.1 sevan #define RGE_NEXT_RX_DESC(x) (((x) + 1) % RGE_RX_LIST_CNT) 189 1.1 sevan #define RGE_ADDR_LO(y) ((uint64_t) (y) & 0xffffffff) 190 1.1 sevan #define RGE_ADDR_HI(y) ((uint64_t) (y) >> 32) 191 1.1 sevan #define RGE_OWN(x) (letoh32((x)->rge_cmdsts) & RGE_RDCMDSTS_OWN) 192 1.1 sevan #define RGE_RXBYTES(x) (letoh32((x)->rge_cmdsts) & \ 193 1.1 sevan RGE_RDCMDSTS_FRAGLEN) 194 1.1 sevan 195 1.1 sevan #define RGE_ADV_2500TFDX 0x0080 196 1.1 sevan 197 1.1 sevan /* Tx descriptor */ 198 1.1 sevan struct rge_tx_desc { 199 1.1 sevan uint32_t rge_cmdsts; 200 1.1 sevan uint32_t rge_extsts; 201 1.1 sevan uint32_t rge_addrlo; 202 1.1 sevan uint32_t rge_addrhi; 203 1.1 sevan uint32_t reserved[4]; 204 1.1 sevan }; 205 1.1 sevan 206 1.1 sevan #define RGE_TDCMDSTS_COLL 0x000f0000 207 1.1 sevan #define RGE_TDCMDSTS_EXCESSCOLL 0x00100000 208 1.1 sevan #define RGE_TDCMDSTS_TXERR 0x00800000 209 1.1 sevan #define RGE_TDCMDSTS_EOF 0x10000000 210 1.1 sevan #define RGE_TDCMDSTS_SOF 0x20000000 211 1.1 sevan #define RGE_TDCMDSTS_EOR 0x40000000 212 1.1 sevan #define RGE_TDCMDSTS_OWN 0x80000000 213 1.1 sevan 214 1.1 sevan #define RGE_TDEXTSTS_VTAG 0x00020000 215 1.1 sevan #define RGE_TDEXTSTS_IPCSUM 0x20000000 216 1.1 sevan #define RGE_TDEXTSTS_TCPCSUM 0x40000000 217 1.1 sevan #define RGE_TDEXTSTS_UDPCSUM 0x80000000 218 1.1 sevan 219 1.1 sevan /* Rx descriptor */ 220 1.1 sevan struct rge_rx_desc { 221 1.1 sevan uint32_t rge_cmdsts; 222 1.1 sevan uint32_t rge_extsts; 223 1.1 sevan uint32_t rge_addrlo; 224 1.1 sevan uint32_t rge_addrhi; 225 1.1 sevan }; 226 1.1 sevan 227 1.1 sevan #define RGE_RDCMDSTS_TCPCSUMERR 0x00004000 228 1.1 sevan #define RGE_RDCMDSTS_UDPCSUMERR 0x00008000 229 1.1 sevan #define RGE_RDCMDSTS_IPCSUMERR 0x00010000 230 1.1 sevan #define RGE_RDCMDSTS_TCPPKT 0x00020000 231 1.1 sevan #define RGE_RDCMDSTS_UDPPKT 0x00040000 232 1.1 sevan #define RGE_RDCMDSTS_RXERRSUM 0x00200000 233 1.1 sevan #define RGE_RDCMDSTS_EOF 0x10000000 234 1.1 sevan #define RGE_RDCMDSTS_SOF 0x20000000 235 1.1 sevan #define RGE_RDCMDSTS_EOR 0x40000000 236 1.1 sevan #define RGE_RDCMDSTS_OWN 0x80000000 237 1.1 sevan #define RGE_RDCMDSTS_FRAGLEN 0x00003fff 238 1.1 sevan 239 1.1 sevan #define RGE_RDEXTSTS_VTAG 0x00010000 240 1.1 sevan #define RGE_RDEXTSTS_VLAN_MASK 0x0000ffff 241 1.1 sevan #define RGE_RDEXTSTS_IPV4 0x40000000 242 1.1 sevan #define RGE_RDEXTSTS_IPV6 0x80000000 243 1.1 sevan 244 1.1 sevan struct rge_txq { 245 1.1 sevan struct mbuf *txq_mbuf; 246 1.1 sevan bus_dmamap_t txq_dmamap; 247 1.1 sevan int txq_descidx; 248 1.1 sevan }; 249 1.1 sevan 250 1.1 sevan struct rge_rxq { 251 1.1 sevan struct mbuf *rxq_mbuf; 252 1.1 sevan bus_dmamap_t rxq_dmamap; 253 1.1 sevan }; 254 1.1 sevan 255 1.1 sevan struct rge_list_data { 256 1.1 sevan struct rge_txq rge_txq[RGE_TX_LIST_CNT]; 257 1.1 sevan int rge_txq_prodidx; 258 1.1 sevan int rge_txq_considx; 259 1.1 sevan struct rge_rxq rge_rxq[RGE_RX_LIST_CNT]; 260 1.1 sevan int rge_rxq_prodidx; 261 1.4.2.1 thorpej int rge_rxq_considx; 262 1.1 sevan 263 1.1 sevan bus_dma_segment_t rge_tx_listseg; 264 1.1 sevan int rge_tx_listnseg; 265 1.1 sevan bus_dmamap_t rge_tx_list_map; 266 1.1 sevan struct rge_tx_desc *rge_tx_list; 267 1.1 sevan bus_dma_segment_t rge_rx_listseg; 268 1.1 sevan int rge_rx_listnseg; 269 1.1 sevan bus_dmamap_t rge_rx_list_map; 270 1.1 sevan struct rge_rx_desc *rge_rx_list; 271 1.1 sevan }; 272 1.1 sevan 273 1.1 sevan /* Microcode version */ 274 1.1 sevan #define RGE_MAC_CFG2_MCODE_VER 0x0b11 275 1.1 sevan #define RGE_MAC_CFG3_MCODE_VER 0x0b33 276 1.4.2.1 thorpej #define RGE_MAC_CFG4_MCODE_VER 0x0b17 277 1.4.2.1 thorpej #define RGE_MAC_CFG5_MCODE_VER 0x0b36 278 1.1 sevan 279 1.1 sevan enum rge_mac_type { 280 1.1 sevan MAC_CFG_UNKNOWN = 1, 281 1.1 sevan MAC_CFG2, 282 1.4.2.1 thorpej MAC_CFG3, 283 1.4.2.1 thorpej MAC_CFG4, 284 1.4.2.1 thorpej MAC_CFG5 285 1.1 sevan }; 286 1.1 sevan 287 1.1 sevan #define RGE_TIMEOUT 100 288 1.1 sevan 289 1.4.2.1 thorpej #if 0 290 1.1 sevan #define RGE_JUMBO_FRAMELEN 9216 291 1.4.2.1 thorpej #else 292 1.4.2.1 thorpej #define RGE_JUMBO_FRAMELEN (MCLBYTES - ETHER_ALIGN) 293 1.4.2.1 thorpej #endif 294 1.1 sevan #define RGE_JUMBO_MTU \ 295 1.1 sevan (RGE_JUMBO_FRAMELEN - ETHER_HDR_LEN - ETHER_CRC_LEN - \ 296 1.1 sevan ETHER_VLAN_ENCAP_LEN) 297 1.1 sevan 298 1.1 sevan #define RGE_TXCFG_CONFIG 0x03000700 299 1.1 sevan #define RGE_RXCFG_CONFIG 0x40c00700 300 1.1 sevan 301 1.1 sevan struct rge_softc { 302 1.4 sevan device_t sc_dev; 303 1.2 sevan struct ethercom sc_ec; /* Ethernet common data */ 304 1.1 sevan void *sc_ih; /* interrupt vectoring */ 305 1.1 sevan bus_space_handle_t rge_bhandle; /* bus space handle */ 306 1.1 sevan bus_space_tag_t rge_btag; /* bus space tag */ 307 1.1 sevan bus_size_t rge_bsize; 308 1.1 sevan bus_dma_tag_t sc_dmat; 309 1.1 sevan pci_chipset_tag_t sc_pc; 310 1.1 sevan pcitag_t sc_tag; 311 1.1 sevan bus_dma_segment_t sc_rx_seg; 312 1.1 sevan bus_dmamap_t sc_rx_dmamap; 313 1.1 sevan struct ifmedia sc_media; /* media info */ 314 1.1 sevan enum rge_mac_type rge_type; 315 1.1 sevan struct mbuf *rge_head; 316 1.1 sevan struct mbuf *rge_tail; 317 1.1 sevan 318 1.1 sevan struct rge_list_data rge_ldata; 319 1.1 sevan 320 1.3 sevan struct work sc_task; 321 1.1 sevan 322 1.2 sevan callout_t sc_timeout; /* tick timeout */ 323 1.1 sevan 324 1.4.2.1 thorpej uint8_t sc_enaddr[ETHER_ADDR_LEN]; 325 1.4.2.1 thorpej uint16_t rge_mcodever; 326 1.1 sevan uint32_t rge_flags; 327 1.1 sevan #define RGE_FLAG_MSI 0x00000001 328 1.1 sevan 329 1.1 sevan uint32_t rge_intrs; 330 1.1 sevan uint32_t rge_tx_ack; 331 1.1 sevan uint32_t rge_rx_ack; 332 1.1 sevan int rge_timerintr; 333 1.1 sevan #define RGE_IMTYPE_NONE 0 334 1.1 sevan #define RGE_IMTYPE_SIM 1 335 1.1 sevan }; 336 1.1 sevan 337 1.1 sevan /* 338 1.1 sevan * Register space access macros. 339 1.1 sevan */ 340 1.1 sevan #define RGE_WRITE_4(sc, reg, val) \ 341 1.1 sevan bus_space_write_4(sc->rge_btag, sc->rge_bhandle, reg, val) 342 1.1 sevan #define RGE_WRITE_2(sc, reg, val) \ 343 1.1 sevan bus_space_write_2(sc->rge_btag, sc->rge_bhandle, reg, val) 344 1.1 sevan #define RGE_WRITE_1(sc, reg, val) \ 345 1.1 sevan bus_space_write_1(sc->rge_btag, sc->rge_bhandle, reg, val) 346 1.1 sevan 347 1.1 sevan #define RGE_READ_4(sc, reg) \ 348 1.1 sevan bus_space_read_4(sc->rge_btag, sc->rge_bhandle, reg) 349 1.1 sevan #define RGE_READ_2(sc, reg) \ 350 1.1 sevan bus_space_read_2(sc->rge_btag, sc->rge_bhandle, reg) 351 1.1 sevan #define RGE_READ_1(sc, reg) \ 352 1.1 sevan bus_space_read_1(sc->rge_btag, sc->rge_bhandle, reg) 353 1.1 sevan 354 1.1 sevan #define RGE_SETBIT_4(sc, reg, val) \ 355 1.1 sevan RGE_WRITE_4(sc, reg, RGE_READ_4(sc, reg) | (val)) 356 1.1 sevan #define RGE_SETBIT_2(sc, reg, val) \ 357 1.1 sevan RGE_WRITE_2(sc, reg, RGE_READ_2(sc, reg) | (val)) 358 1.1 sevan #define RGE_SETBIT_1(sc, reg, val) \ 359 1.1 sevan RGE_WRITE_1(sc, reg, RGE_READ_1(sc, reg) | (val)) 360 1.1 sevan 361 1.1 sevan #define RGE_CLRBIT_4(sc, reg, val) \ 362 1.1 sevan RGE_WRITE_4(sc, reg, RGE_READ_4(sc, reg) & ~(val)) 363 1.1 sevan #define RGE_CLRBIT_2(sc, reg, val) \ 364 1.1 sevan RGE_WRITE_2(sc, reg, RGE_READ_2(sc, reg) & ~(val)) 365 1.1 sevan #define RGE_CLRBIT_1(sc, reg, val) \ 366 1.1 sevan RGE_WRITE_1(sc, reg, RGE_READ_1(sc, reg) & ~(val)) 367 1.1 sevan 368 1.4.2.1 thorpej #define RGE_EPHY_SETBIT(sc, reg, val) \ 369 1.4.2.1 thorpej rge_write_ephy(sc, reg, rge_read_ephy(sc, reg) | (val)) 370 1.4.2.1 thorpej 371 1.4.2.1 thorpej #define RGE_EPHY_CLRBIT(sc, reg, val) \ 372 1.4.2.1 thorpej rge_write_ephy(sc, reg, rge_read_ephy(sc, reg) & ~(val)) 373 1.4.2.1 thorpej 374 1.1 sevan #define RGE_PHY_SETBIT(sc, reg, val) \ 375 1.1 sevan rge_write_phy_ocp(sc, reg, rge_read_phy_ocp(sc, reg) | (val)) 376 1.1 sevan 377 1.1 sevan #define RGE_PHY_CLRBIT(sc, reg, val) \ 378 1.1 sevan rge_write_phy_ocp(sc, reg, rge_read_phy_ocp(sc, reg) & ~(val)) 379 1.1 sevan 380 1.1 sevan #define RGE_MAC_SETBIT(sc, reg, val) \ 381 1.1 sevan rge_write_mac_ocp(sc, reg, rge_read_mac_ocp(sc, reg) | (val)) 382 1.1 sevan 383 1.1 sevan #define RGE_MAC_CLRBIT(sc, reg, val) \ 384 1.1 sevan rge_write_mac_ocp(sc, reg, rge_read_mac_ocp(sc, reg) & ~(val)) 385 1.1 sevan 386 1.4.2.1 thorpej static const struct { 387 1.4.2.1 thorpej uint16_t reg; 388 1.4.2.1 thorpej uint16_t val; 389 1.4.2.1 thorpej } rtl8125_mac_bps[] = { 390 1.4.2.1 thorpej { 0xf800, 0xe008 }, { 0xf802, 0xe01e }, { 0xf804, 0xe02e }, 391 1.4.2.1 thorpej { 0xf806, 0xe054 }, { 0xf808, 0xe057 }, { 0xf80a, 0xe059 }, 392 1.4.2.1 thorpej { 0xf80c, 0xe0c2 }, { 0xf80e, 0xe0cb }, { 0xf810, 0x9996 }, 393 1.4.2.1 thorpej { 0xf812, 0x49d1 }, { 0xf814, 0xf005 }, { 0xf816, 0x49d4 }, 394 1.4.2.1 thorpej { 0xf818, 0xf10a }, { 0xf81a, 0x49d8 }, { 0xf81c, 0xf108 }, 395 1.4.2.1 thorpej { 0xf81e, 0xc00f }, { 0xf820, 0x7100 }, { 0xf822, 0x209c }, 396 1.4.2.1 thorpej { 0xf824, 0x249c }, { 0xf826, 0xc009 }, { 0xf828, 0x9900 }, 397 1.4.2.1 thorpej { 0xf82a, 0xe004 }, { 0xf82c, 0xc006 }, { 0xf82e, 0x1900 }, 398 1.4.2.1 thorpej { 0xf830, 0x9900 }, { 0xf832, 0xc602 }, { 0xf834, 0xbe00 }, 399 1.4.2.1 thorpej { 0xf836, 0x5a48 }, { 0xf838, 0xe0c2 }, { 0xf83a, 0x0004 }, 400 1.4.2.1 thorpej { 0xf83c, 0xe10a }, { 0xf83e, 0xc60f }, { 0xf840, 0x73c4 }, 401 1.4.2.1 thorpej { 0xf842, 0x49b3 }, { 0xf844, 0xf106 }, { 0xf846, 0x73c2 }, 402 1.4.2.1 thorpej { 0xf848, 0xc608 }, { 0xf84a, 0xb406 }, { 0xf84c, 0xc609 }, 403 1.4.2.1 thorpej { 0xf84e, 0xff80 }, { 0xf850, 0xc605 }, { 0xf852, 0xb406 }, 404 1.4.2.1 thorpej { 0xf854, 0xc605 }, { 0xf856, 0xff80 }, { 0xf858, 0x0544 }, 405 1.4.2.1 thorpej { 0xf85a, 0x0568 }, { 0xf85c, 0xe906 }, { 0xf85e, 0xcde8 }, 406 1.4.2.1 thorpej { 0xf860, 0xc724 }, { 0xf862, 0xc624 }, { 0xf864, 0x9ee2 }, 407 1.4.2.1 thorpej { 0xf866, 0x1e01 }, { 0xf868, 0x9ee0 }, { 0xf86a, 0x76e0 }, 408 1.4.2.1 thorpej { 0xf86c, 0x49e0 }, { 0xf86e, 0xf1fe }, { 0xf870, 0x76e6 }, 409 1.4.2.1 thorpej { 0xf872, 0x486d }, { 0xf874, 0x4868 }, { 0xf876, 0x9ee4 }, 410 1.4.2.1 thorpej { 0xf878, 0x1e03 }, { 0xf87a, 0x9ee0 }, { 0xf87c, 0x76e0 }, 411 1.4.2.1 thorpej { 0xf87e, 0x49e0 }, { 0xf880, 0xf1fe }, { 0xf882, 0xc615 }, 412 1.4.2.1 thorpej { 0xf884, 0x9ee2 }, { 0xf886, 0x1e01 }, { 0xf888, 0x9ee0 }, 413 1.4.2.1 thorpej { 0xf88a, 0x76e0 }, { 0xf88c, 0x49e0 }, { 0xf88e, 0xf1fe }, 414 1.4.2.1 thorpej { 0xf890, 0x76e6 }, { 0xf892, 0x486f }, { 0xf894, 0x9ee4 }, 415 1.4.2.1 thorpej { 0xf896, 0x1e03 }, { 0xf898, 0x9ee0 }, { 0xf89a, 0x76e0 }, 416 1.4.2.1 thorpej { 0xf89c, 0x49e0 }, { 0xf89e, 0xf1fe }, { 0xf8a0, 0x7196 }, 417 1.4.2.1 thorpej { 0xf8a2, 0xc702 }, { 0xf8a4, 0xbf00 }, { 0xf8a6, 0x5a44 }, 418 1.4.2.1 thorpej { 0xf8a8, 0xeb0e }, { 0xf8aa, 0x0070 }, { 0xf8ac, 0x00c3 }, 419 1.4.2.1 thorpej { 0xf8ae, 0x1bc0 }, { 0xf8b0, 0xc602 }, { 0xf8b2, 0xbe00 }, 420 1.4.2.1 thorpej { 0xf8b4, 0x0e26 }, { 0xf8b6, 0xc602 }, { 0xf8b8, 0xbe00 }, 421 1.4.2.1 thorpej { 0xf8ba, 0x0eba }, { 0xf8bc, 0x1501 }, { 0xf8be, 0xf02a }, 422 1.4.2.1 thorpej { 0xf8c0, 0x1500 }, { 0xf8c2, 0xf15d }, { 0xf8c4, 0xc661 }, 423 1.4.2.1 thorpej { 0xf8c6, 0x75c8 }, { 0xf8c8, 0x49d5 }, { 0xf8ca, 0xf00a }, 424 1.4.2.1 thorpej { 0xf8cc, 0x49d6 }, { 0xf8ce, 0xf008 }, { 0xf8d0, 0x49d7 }, 425 1.4.2.1 thorpej { 0xf8d2, 0xf006 }, { 0xf8d4, 0x49d8 }, { 0xf8d6, 0xf004 }, 426 1.4.2.1 thorpej { 0xf8d8, 0x75d2 }, { 0xf8da, 0x49d9 }, { 0xf8dc, 0xf150 }, 427 1.4.2.1 thorpej { 0xf8de, 0xc553 }, { 0xf8e0, 0x77a0 }, { 0xf8e2, 0x75c8 }, 428 1.4.2.1 thorpej { 0xf8e4, 0x4855 }, { 0xf8e6, 0x4856 }, { 0xf8e8, 0x4857 }, 429 1.4.2.1 thorpej { 0xf8ea, 0x4858 }, { 0xf8ec, 0x48da }, { 0xf8ee, 0x48db }, 430 1.4.2.1 thorpej { 0xf8f0, 0x49fe }, { 0xf8f2, 0xf002 }, { 0xf8f4, 0x485a }, 431 1.4.2.1 thorpej { 0xf8f6, 0x49ff }, { 0xf8f8, 0xf002 }, { 0xf8fa, 0x485b }, 432 1.4.2.1 thorpej { 0xf8fc, 0x9dc8 }, { 0xf8fe, 0x75d2 }, { 0xf900, 0x4859 }, 433 1.4.2.1 thorpej { 0xf902, 0x9dd2 }, { 0xf904, 0xc643 }, { 0xf906, 0x75c0 }, 434 1.4.2.1 thorpej { 0xf908, 0x49d4 }, { 0xf90a, 0xf033 }, { 0xf90c, 0x49d0 }, 435 1.4.2.1 thorpej { 0xf90e, 0xf137 }, { 0xf910, 0xe030 }, { 0xf912, 0xc63a }, 436 1.4.2.1 thorpej { 0xf914, 0x75c8 }, { 0xf916, 0x49d5 }, { 0xf918, 0xf00e }, 437 1.4.2.1 thorpej { 0xf91a, 0x49d6 }, { 0xf91c, 0xf00c }, { 0xf91e, 0x49d7 }, 438 1.4.2.1 thorpej { 0xf920, 0xf00a }, { 0xf922, 0x49d8 }, { 0xf924, 0xf008 }, 439 1.4.2.1 thorpej { 0xf926, 0x75d2 }, { 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