xref: /src/sys/external/gpl2/dts/dist/include/dt-bindings/clock/qcom,gcc-msm8917.h

/*	$NetBSD: qcom,gcc-msm8917.h,v 1.1.1.1 2026/01/18 05:21:35 skrll Exp $	*/

/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */

#ifndef _DT_BINDINGS_CLK_MSM_GCC_8917_H
#define _DT_BINDINGS_CLK_MSM_GCC_8917_H

/* Clocks */
#define APSS_AHB_CLK_SRC			0
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#define BLSP1_QUP2_SPI_APPS_CLK_SRC		2
#define BLSP1_QUP3_I2C_APPS_CLK_SRC		3
#define BLSP1_QUP3_SPI_APPS_CLK_SRC		4
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#define BLSP2_QUP1_SPI_APPS_CLK_SRC		10
#define BLSP2_QUP2_I2C_APPS_CLK_SRC		11
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#define BLSP2_QUP3_I2C_APPS_CLK_SRC		13
#define BLSP2_QUP3_SPI_APPS_CLK_SRC		14
#define BLSP2_UART1_APPS_CLK_SRC		15
#define BLSP2_UART2_APPS_CLK_SRC		16
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#define CAMSS_GP1_CLK_SRC			19
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#define GCC_BLSP1_QUP3_I2C_APPS_CLK		36
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#define GCC_BLSP1_QUP4_I2C_APPS_CLK		38
#define GCC_BLSP1_QUP4_SPI_APPS_CLK		39
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#define GCC_BLSP2_AHB_CLK			42
#define GCC_BLSP2_QUP1_I2C_APPS_CLK		43
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#define GCC_BLSP2_QUP3_I2C_APPS_CLK		47
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#define GCC_BLSP2_UART1_APPS_CLK		49
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#define GCC_CAMSS_VFE0_CLK			89
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#define GCC_CAMSS_VFE1_AXI_CLK			91
#define GCC_CAMSS_VFE1_CLK			92
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#define GCC_MDP_TBU_CLK				105
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#define GCC_MDSS_BYTE0_CLK			108
#define GCC_MDSS_ESC0_CLK			109
#define GCC_MDSS_MDP_CLK			110
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#define GCC_MDSS_VSYNC_CLK			112
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#define GCC_MSS_Q6_BIMC_AXI_CLK			114
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#define GCC_OXILI_GFX3D_CLK			116
#define GCC_PDM2_CLK				117
#define GCC_PDM_AHB_CLK				118
#define GCC_PRNG_AHB_CLK			119
#define GCC_QDSS_DAP_CLK			120
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#define GCC_SDCC1_APPS_CLK			122
#define GCC_SDCC1_ICE_CORE_CLK			123
#define GCC_SDCC2_AHB_CLK			124
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#define GCC_SMMU_CFG_CLK			126
#define GCC_USB2A_PHY_SLEEP_CLK			127
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#define GCC_USB_HS_PHY_CFG_AHB_CLK		129
#define GCC_USB_HS_SYSTEM_CLK			130
#define GCC_VENUS0_AHB_CLK			131
#define GCC_VENUS0_AXI_CLK			132
#define GCC_VENUS0_CORE0_VCODEC0_CLK		133
#define GCC_VENUS0_VCODEC0_CLK			134
#define GCC_VENUS_TBU_CLK			135
#define GCC_VFE1_TBU_CLK			136
#define GCC_VFE_TBU_CLK				137
#define GFX3D_CLK_SRC				138
#define GP1_CLK_SRC				139
#define GP2_CLK_SRC				140
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#define GPLL0					142
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#define GPLL3_EARLY				145
#define GPLL4					146
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#define GPLL6					148
#define GPLL6_EARLY				149
#define JPEG0_CLK_SRC				150
#define MCLK0_CLK_SRC				151
#define MCLK1_CLK_SRC				152
#define MCLK2_CLK_SRC				153
#define MDP_CLK_SRC				154
#define PCLK0_CLK_SRC				155
#define PDM2_CLK_SRC				156
#define SDCC1_APPS_CLK_SRC			157
#define SDCC1_ICE_CORE_CLK_SRC			158
#define SDCC2_APPS_CLK_SRC			159
#define USB_HS_SYSTEM_CLK_SRC			160
#define VCODEC0_CLK_SRC				161
#define VFE0_CLK_SRC				162
#define VFE1_CLK_SRC				163
#define VSYNC_CLK_SRC				164
#define GPLL0_SLEEP_CLK_SRC			165

/* GCC block resets */
#define GCC_CAMSS_MICRO_BCR			0
#define GCC_MSS_BCR				1
#define GCC_QUSB2_PHY_BCR			2
#define GCC_USB_HS_BCR				3
#define GCC_USB2_HS_PHY_ONLY_BCR		4

/* GDSCs */
#define CPP_GDSC				0
#define JPEG_GDSC				1
#define MDSS_GDSC				2
#define OXILI_GX_GDSC				3
#define VENUS_CORE0_GDSC			4
#define VENUS_GDSC				5
#define VFE0_GDSC				6
#define VFE1_GDSC				7

#endif