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  /src/sys/external/bsd/drm2/dist/drm/radeon/
nid.h 85 #define SOFT_RESET_RLC (1 << 13)
cikd.h 1079 #define SOFT_RESET_RLC (1 << 2) /* RLC */
sid.h 987 #define SOFT_RESET_RLC (1 << 2)
radeon_si.c 3940 grbm_soft_reset |= SOFT_RESET_RLC;
5818 tmp |= SOFT_RESET_RLC;
5821 tmp &= ~SOFT_RESET_RLC;
evergreend.h 1192 #define SOFT_RESET_RLC (1 << 13)
r600d.h 706 # define SOFT_RESET_RLC (1 << 13)
radeon_ni.c 1907 srbm_soft_reset |= SOFT_RESET_RLC;
radeon_r600.c 3572 WREG32(SRBM_SOFT_RESET, SOFT_RESET_RLC);
radeon_evergreen.c 3958 srbm_soft_reset |= SOFT_RESET_RLC;
radeon_cik.c 5016 grbm_soft_reset |= SOFT_RESET_RLC;
  /src/sys/external/bsd/drm2/dist/drm/amd/amdgpu/
amdgpu_gfx_v10_0.c 1812 WREG32_FIELD15(GC, 0, GRBM_SOFT_RESET, SOFT_RESET_RLC, 1);
1814 WREG32_FIELD15(GC, 0, GRBM_SOFT_RESET, SOFT_RESET_RLC, 0);
3896 GRBM_SOFT_RESET, SOFT_RESET_RLC,
amdgpu_gfx_v6_0.c 2505 WREG32_FIELD(GRBM_SOFT_RESET, SOFT_RESET_RLC, 1);
2507 WREG32_FIELD(GRBM_SOFT_RESET, SOFT_RESET_RLC, 0);
amdgpu_gfx_v8_0.c 4087 WREG32_FIELD(GRBM_SOFT_RESET, SOFT_RESET_RLC, 1);
4090 WREG32_FIELD(GRBM_SOFT_RESET, SOFT_RESET_RLC, 0);
4975 GRBM_SOFT_RESET, SOFT_RESET_RLC, 1);
amdgpu_gfx_v9_0.c 2933 WREG32_FIELD15(GC, 0, GRBM_SOFT_RESET, SOFT_RESET_RLC, 1);
2935 WREG32_FIELD15(GC, 0, GRBM_SOFT_RESET, SOFT_RESET_RLC, 0);
3938 GRBM_SOFT_RESET, SOFT_RESET_RLC, 1);
sid.h 986 #define SOFT_RESET_RLC (1 << 2)

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