1/*	$NetBSD: qcom,gcc-sc8280xp.h,v 1.1.1.1 2026/01/18 05:21:35 skrll Exp $	*/
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3/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
4/*
5 * Copyright (c) 2021, The Linux Foundation. All rights reserved.
6 * Copyright (c) 2022, Linaro Ltd.
7 */
8
9#ifndef _DT_BINDINGS_CLK_QCOM_GCC_DIREWOLF_H
10#define _DT_BINDINGS_CLK_QCOM_GCC_DIREWOLF_H
11
12/* GCC clocks */
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263#define GCC_SYS_NOC_USB_AXI_CLK				250
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265#define GCC_UFS_CARD_AHB_CLK				252
266#define GCC_UFS_CARD_AXI_CLK				253
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281#define GCC_UFS_PHY_AHB_CLK				268
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284#define GCC_UFS_PHY_ICE_CORE_CLK			271
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299#define GCC_USB2_HS2_CLKREF_CLK				286
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301#define GCC_USB30_MP_MASTER_CLK				288
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305#define GCC_USB30_MP_MOCK_UTMI_POSTDIV_CLK_SRC		292
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307#define GCC_USB30_PRIM_MASTER_CLK			294
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329#define GCC_USB3_MP_PHY_PIPE_1_CLK_SRC			316
330#define GCC_USB3_PRIM_PHY_AUX_CLK			317
331#define GCC_USB3_PRIM_PHY_AUX_CLK_SRC			318
332#define GCC_USB3_PRIM_PHY_COM_AUX_CLK			319
333#define GCC_USB3_PRIM_PHY_PIPE_CLK			320
334#define GCC_USB3_PRIM_PHY_PIPE_CLK_SRC			321
335#define GCC_USB3_SEC_PHY_AUX_CLK			322
336#define GCC_USB3_SEC_PHY_AUX_CLK_SRC			323
337#define GCC_USB3_SEC_PHY_COM_AUX_CLK			324
338#define GCC_USB3_SEC_PHY_PIPE_CLK			325
339#define GCC_USB3_SEC_PHY_PIPE_CLK_SRC			326
340#define GCC_USB4_1_CFG_AHB_CLK				327
341#define GCC_USB4_1_DP_CLK				328
342#define GCC_USB4_1_MASTER_CLK				329
343#define GCC_USB4_1_MASTER_CLK_SRC			330
344#define GCC_USB4_1_PHY_DP_CLK_SRC			331
345#define GCC_USB4_1_PHY_P2RR2P_PIPE_CLK			332
346#define GCC_USB4_1_PHY_P2RR2P_PIPE_CLK_SRC		333
347#define GCC_USB4_1_PHY_PCIE_PIPE_CLK			334
348#define GCC_USB4_1_PHY_PCIE_PIPE_CLK_SRC		335
349#define GCC_USB4_1_PHY_PCIE_PIPE_MUX_CLK_SRC		336
350#define GCC_USB4_1_PHY_PCIE_PIPEGMUX_CLK_SRC		337
351#define GCC_USB4_1_PHY_RX0_CLK				338
352#define GCC_USB4_1_PHY_RX0_CLK_SRC			339
353#define GCC_USB4_1_PHY_RX1_CLK				340
354#define GCC_USB4_1_PHY_RX1_CLK_SRC			341
355#define GCC_USB4_1_PHY_SYS_CLK_SRC			342
356#define GCC_USB4_1_PHY_USB_PIPE_CLK			343
357#define GCC_USB4_1_SB_IF_CLK				344
358#define GCC_USB4_1_SB_IF_CLK_SRC			345
359#define GCC_USB4_1_SYS_CLK				346
360#define GCC_USB4_1_TMU_CLK				347
361#define GCC_USB4_1_TMU_CLK_SRC				348
362#define GCC_USB4_CFG_AHB_CLK				349
363#define GCC_USB4_CLKREF_CLK				350
364#define GCC_USB4_DP_CLK					351
365#define GCC_USB4_EUD_CLKREF_CLK				352
366#define GCC_USB4_MASTER_CLK				353
367#define GCC_USB4_MASTER_CLK_SRC				354
368#define GCC_USB4_PHY_DP_CLK_SRC				355
369#define GCC_USB4_PHY_P2RR2P_PIPE_CLK			356
370#define GCC_USB4_PHY_P2RR2P_PIPE_CLK_SRC		357
371#define GCC_USB4_PHY_PCIE_PIPE_CLK			358
372#define GCC_USB4_PHY_PCIE_PIPE_CLK_SRC			359
373#define GCC_USB4_PHY_PCIE_PIPE_MUX_CLK_SRC		360
374#define GCC_USB4_PHY_PCIE_PIPEGMUX_CLK_SRC		361
375#define GCC_USB4_PHY_RX0_CLK				362
376#define GCC_USB4_PHY_RX0_CLK_SRC			363
377#define GCC_USB4_PHY_RX1_CLK				364
378#define GCC_USB4_PHY_RX1_CLK_SRC			365
379#define GCC_USB4_PHY_SYS_CLK_SRC			366
380#define GCC_USB4_PHY_USB_PIPE_CLK			367
381#define GCC_USB4_SB_IF_CLK				368
382#define GCC_USB4_SB_IF_CLK_SRC				369
383#define GCC_USB4_SYS_CLK				370
384#define GCC_USB4_TMU_CLK				371
385#define GCC_USB4_TMU_CLK_SRC				372
386#define GCC_VIDEO_AHB_CLK				373
387#define GCC_VIDEO_AXI0_CLK				374
388#define GCC_VIDEO_AXI1_CLK				375
389#define GCC_VIDEO_CVP_THROTTLE_CLK			376
390#define GCC_VIDEO_VCODEC_THROTTLE_CLK			377
391#define GCC_VIDEO_XO_CLK				378
392#define GCC_AGGRE_UFS_CARD_AXI_HW_CTL_CLK		379
393#define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK		380
394#define GCC_UFS_CARD_AXI_HW_CTL_CLK			381
395#define GCC_UFS_CARD_ICE_CORE_HW_CTL_CLK		382
396#define GCC_UFS_CARD_PHY_AUX_HW_CTL_CLK			383
397#define GCC_UFS_CARD_UNIPRO_CORE_HW_CTL_CLK		384
398#define GCC_UFS_PHY_AXI_HW_CTL_CLK			385
399#define GCC_UFS_PHY_ICE_CORE_HW_CTL_CLK			386
400#define GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK			387
401#define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK		388
402
403/* GCC resets */
404#define GCC_EMAC0_BCR					0
405#define GCC_EMAC1_BCR					1
406#define GCC_PCIE_0_LINK_DOWN_BCR			2
407#define GCC_PCIE_0_NOCSR_COM_PHY_BCR			3
408#define GCC_PCIE_0_PHY_BCR				4
409#define GCC_PCIE_0_PHY_NOCSR_COM_PHY_BCR		5
410#define GCC_PCIE_0_TUNNEL_BCR				6
411#define GCC_PCIE_1_LINK_DOWN_BCR			7
412#define GCC_PCIE_1_NOCSR_COM_PHY_BCR			8
413#define GCC_PCIE_1_PHY_BCR				9
414#define GCC_PCIE_1_PHY_NOCSR_COM_PHY_BCR		10
415#define GCC_PCIE_1_TUNNEL_BCR				11
416#define GCC_PCIE_2A_BCR					12
417#define GCC_PCIE_2A_LINK_DOWN_BCR			13
418#define GCC_PCIE_2A_NOCSR_COM_PHY_BCR			14
419#define GCC_PCIE_2A_PHY_BCR				15
420#define GCC_PCIE_2A_PHY_NOCSR_COM_PHY_BCR		16
421#define GCC_PCIE_2B_BCR					17
422#define GCC_PCIE_2B_LINK_DOWN_BCR			18
423#define GCC_PCIE_2B_NOCSR_COM_PHY_BCR			19
424#define GCC_PCIE_2B_PHY_BCR				20
425#define GCC_PCIE_2B_PHY_NOCSR_COM_PHY_BCR		21
426#define GCC_PCIE_3A_BCR					22
427#define GCC_PCIE_3A_LINK_DOWN_BCR			23
428#define GCC_PCIE_3A_NOCSR_COM_PHY_BCR			24
429#define GCC_PCIE_3A_PHY_BCR				25
430#define GCC_PCIE_3A_PHY_NOCSR_COM_PHY_BCR		26
431#define GCC_PCIE_3B_BCR					27
432#define GCC_PCIE_3B_LINK_DOWN_BCR			28
433#define GCC_PCIE_3B_NOCSR_COM_PHY_BCR			29
434#define GCC_PCIE_3B_PHY_BCR				30
435#define GCC_PCIE_3B_PHY_NOCSR_COM_PHY_BCR		31
436#define GCC_PCIE_4_BCR					32
437#define GCC_PCIE_4_LINK_DOWN_BCR			33
438#define GCC_PCIE_4_NOCSR_COM_PHY_BCR			34
439#define GCC_PCIE_4_PHY_BCR				35
440#define GCC_PCIE_4_PHY_NOCSR_COM_PHY_BCR		36
441#define GCC_PCIE_PHY_CFG_AHB_BCR			37
442#define GCC_PCIE_PHY_COM_BCR				38
443#define GCC_PCIE_RSCC_BCR				39
444#define GCC_QUSB2PHY_HS0_MP_BCR				40
445#define GCC_QUSB2PHY_HS1_MP_BCR				41
446#define GCC_QUSB2PHY_HS2_MP_BCR				42
447#define GCC_QUSB2PHY_HS3_MP_BCR				43
448#define GCC_QUSB2PHY_PRIM_BCR				44
449#define GCC_QUSB2PHY_SEC_BCR				45
450#define GCC_SDCC2_BCR					46
451#define GCC_SDCC4_BCR					47
452#define GCC_UFS_CARD_BCR				48
453#define GCC_UFS_PHY_BCR					49
454#define GCC_USB2_PHY_PRIM_BCR				50
455#define GCC_USB2_PHY_SEC_BCR				51
456#define GCC_USB30_MP_BCR				52
457#define GCC_USB30_PRIM_BCR				53
458#define GCC_USB30_SEC_BCR				54
459#define GCC_USB3_DP_PHY_PRIM_BCR			55
460#define GCC_USB3_DP_PHY_SEC_BCR				56
461#define GCC_USB3_PHY_PRIM_BCR				57
462#define GCC_USB3_PHY_SEC_BCR				58
463#define GCC_USB3_UNIPHY_MP0_BCR				59
464#define GCC_USB3_UNIPHY_MP1_BCR				60
465#define GCC_USB3PHY_PHY_PRIM_BCR			61
466#define GCC_USB3PHY_PHY_SEC_BCR				62
467#define GCC_USB3UNIPHY_PHY_MP0_BCR			63
468#define GCC_USB3UNIPHY_PHY_MP1_BCR			64
469#define GCC_USB4_1_BCR					65
470#define GCC_USB4_1_DP_PHY_PRIM_BCR			66
471#define GCC_USB4_1_DPPHY_AUX_BCR			67
472#define GCC_USB4_1_PHY_PRIM_BCR				68
473#define GCC_USB4_BCR					69
474#define GCC_USB4_DP_PHY_PRIM_BCR			70
475#define GCC_USB4_DPPHY_AUX_BCR				71
476#define GCC_USB4_PHY_PRIM_BCR				72
477#define GCC_USB4PHY_1_PHY_PRIM_BCR			73
478#define GCC_USB4PHY_PHY_PRIM_BCR			74
479#define GCC_USB_PHY_CFG_AHB2PHY_BCR			75
480#define GCC_VIDEO_BCR					76
481#define GCC_VIDEO_AXI0_CLK_ARES				77
482#define GCC_VIDEO_AXI1_CLK_ARES				78
483
484/* GCC GDSCs */
485#define PCIE_0_TUNNEL_GDSC				0
486#define PCIE_1_TUNNEL_GDSC				1
487#define PCIE_2A_GDSC					2
488#define PCIE_2B_GDSC					3
489#define PCIE_3A_GDSC					4
490#define PCIE_3B_GDSC					5
491#define PCIE_4_GDSC					6
492#define UFS_CARD_GDSC					7
493#define UFS_PHY_GDSC					8
494#define USB30_MP_GDSC					9
495#define USB30_PRIM_GDSC					10
496#define USB30_SEC_GDSC					11
497#define EMAC_0_GDSC					12
498#define EMAC_1_GDSC					13
499#define USB4_1_GDSC					14
500#define USB4_GDSC					15
501#define HLOS1_VOTE_MMNOC_MMU_TBU_HF0_GDSC		16
502#define HLOS1_VOTE_MMNOC_MMU_TBU_HF1_GDSC		17
503#define HLOS1_VOTE_MMNOC_MMU_TBU_SF0_GDSC		18
504#define HLOS1_VOTE_MMNOC_MMU_TBU_SF1_GDSC		19
505#define HLOS1_VOTE_TURING_MMU_TBU0_GDSC			20
506#define HLOS1_VOTE_TURING_MMU_TBU1_GDSC			21
507#define HLOS1_VOTE_TURING_MMU_TBU2_GDSC			22
508#define HLOS1_VOTE_TURING_MMU_TBU3_GDSC			23
509
510#endif
511