xref: /src/sys/external/gpl2/dts/dist/include/dt-bindings/clock/qcom,gcc-msm8953.h

/*	$NetBSD: qcom,gcc-msm8953.h,v 1.1.1.1 2021/11/07 16:50:00 jmcneill Exp $	*/

/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */

#ifndef _DT_BINDINGS_CLK_MSM_GCC_8953_H
#define _DT_BINDINGS_CLK_MSM_GCC_8953_H

/* Clocks */
#define APC0_DROOP_DETECTOR_CLK_SRC		0
#define APC1_DROOP_DETECTOR_CLK_SRC		1
#define APSS_AHB_CLK_SRC			2
#define BLSP1_QUP1_I2C_APPS_CLK_SRC		3
#define BLSP1_QUP1_SPI_APPS_CLK_SRC		4
#define BLSP1_QUP2_I2C_APPS_CLK_SRC		5
#define BLSP1_QUP2_SPI_APPS_CLK_SRC		6
#define BLSP1_QUP3_I2C_APPS_CLK_SRC		7
#define BLSP1_QUP3_SPI_APPS_CLK_SRC		8
#define BLSP1_QUP4_I2C_APPS_CLK_SRC		9
#define BLSP1_QUP4_SPI_APPS_CLK_SRC		10
#define BLSP1_UART1_APPS_CLK_SRC		11
#define BLSP1_UART2_APPS_CLK_SRC		12
#define BLSP2_QUP1_I2C_APPS_CLK_SRC		13
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#define BLSP2_QUP2_I2C_APPS_CLK_SRC		15
#define BLSP2_QUP2_SPI_APPS_CLK_SRC		16
#define BLSP2_QUP3_I2C_APPS_CLK_SRC		17
#define BLSP2_QUP3_SPI_APPS_CLK_SRC		18
#define BLSP2_QUP4_I2C_APPS_CLK_SRC		19
#define BLSP2_QUP4_SPI_APPS_CLK_SRC		20
#define BLSP2_UART1_APPS_CLK_SRC		21
#define BLSP2_UART2_APPS_CLK_SRC		22
#define BYTE0_CLK_SRC				23
#define BYTE1_CLK_SRC				24
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#define CAMSS_GP1_CLK_SRC			26
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#define CCI_CLK_SRC				28
#define CPP_CLK_SRC				29
#define CRYPTO_CLK_SRC				30
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#define CSI0_CLK_SRC				33
#define CSI1PHYTIMER_CLK_SRC			34
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#define CSI1_CLK_SRC				36
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#define CSI2P_CLK_SRC				38
#define CSI2_CLK_SRC				39
#define ESC0_CLK_SRC				40
#define ESC1_CLK_SRC				41
#define GCC_APC0_DROOP_DETECTOR_GPLL0_CLK	42
#define GCC_APC1_DROOP_DETECTOR_GPLL0_CLK	43
#define GCC_APSS_AHB_CLK			44
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#define GCC_BLSP1_AHB_CLK			49
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#define GCC_BLSP1_QUP2_I2C_APPS_CLK		52
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#define GCC_CAMSS_CSI0_CLK			83
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#define GCC_OXILI_TIMER_CLK			144
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#define GCC_PRNG_AHB_CLK			148
#define GCC_QDSS_DAP_CLK			149
#define GCC_QUSB_REF_CLK			150
#define GCC_RBCPR_GFX_CLK			151
#define GCC_SDCC1_AHB_CLK			152
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#define GCC_SDCC2_AHB_CLK			155
#define GCC_SDCC2_APPS_CLK			156
#define GCC_SMMU_CFG_CLK			157
#define GCC_USB30_MASTER_CLK			158
#define GCC_USB30_MOCK_UTMI_CLK			159
#define GCC_USB30_SLEEP_CLK			160
#define GCC_USB3_AUX_CLK			161
#define GCC_USB3_PIPE_CLK			162
#define GCC_USB_PHY_CFG_AHB_CLK			163
#define GCC_USB_SS_REF_CLK			164
#define GCC_VENUS0_AHB_CLK			165
#define GCC_VENUS0_AXI_CLK			166
#define GCC_VENUS0_CORE0_VCODEC0_CLK		167
#define GCC_VENUS0_VCODEC0_CLK			168
#define GCC_VENUS_TBU_CLK			169
#define GCC_VFE1_TBU_CLK			170
#define GCC_VFE_TBU_CLK				171
#define GFX3D_CLK_SRC				172
#define GP1_CLK_SRC				173
#define GP2_CLK_SRC				174
#define GP3_CLK_SRC				175
#define GPLL0					176
#define GPLL0_EARLY				177
#define GPLL2					178
#define GPLL2_EARLY				179
#define GPLL3					180
#define GPLL3_EARLY				181
#define GPLL4					182
#define GPLL4_EARLY				183
#define GPLL6					184
#define GPLL6_EARLY				185
#define JPEG0_CLK_SRC				186
#define MCLK0_CLK_SRC				187
#define MCLK1_CLK_SRC				188
#define MCLK2_CLK_SRC				189
#define MCLK3_CLK_SRC				190
#define MDP_CLK_SRC				191
#define PCLK0_CLK_SRC				192
#define PCLK1_CLK_SRC				193
#define PDM2_CLK_SRC				194
#define RBCPR_GFX_CLK_SRC			195
#define SDCC1_APPS_CLK_SRC			196
#define SDCC1_ICE_CORE_CLK_SRC			197
#define SDCC2_APPS_CLK_SRC			198
#define USB30_MASTER_CLK_SRC			199
#define USB30_MOCK_UTMI_CLK_SRC			200
#define USB3_AUX_CLK_SRC			201
#define VCODEC0_CLK_SRC				202
#define VFE0_CLK_SRC				203
#define VFE1_CLK_SRC				204
#define VSYNC_CLK_SRC				205

/* GCC block resets */
#define GCC_CAMSS_MICRO_BCR			0
#define GCC_MSS_BCR				1
#define GCC_QUSB2_PHY_BCR			2
#define GCC_USB3PHY_PHY_BCR			3
#define GCC_USB3_PHY_BCR			4
#define GCC_USB_30_BCR				5

/* GDSCs */
#define CPP_GDSC				0
#define JPEG_GDSC				1
#define MDSS_GDSC				2
#define OXILI_CX_GDSC				3
#define OXILI_GX_GDSC				4
#define USB30_GDSC				5
#define VENUS_CORE0_GDSC			6
#define VENUS_GDSC				7
#define VFE0_GDSC				8
#define VFE1_GDSC				9

#endif